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官方文檔http://www.xilinx.com/support/documentation/application_notes/xapp890-zynq-sobel-vivado-hls.pdf
準備工作
下載 工程檔案 http://pan.baidu.com/s/1eQqwjBk 這是我用百度雲分享的
如果不行了, 可以用 官方連結 https://secure.xilinx.com/webreg/clickthrough.do?cid=193509
sobel 運算元邊緣檢測原理 這裡不多說
就是一個卷積的過程 提取圖片的邊緣
例子
C代碼如下
for(i = 0; i < height, i++){
for(j=0; j < width; j++){
x_dir = 0;
y_dir = 0;
if((i > 0 && (i < (height-1)) && (j > 0) && (j < (width-1))){
for(rowOffset = -1; rowOffset <= 1; rowOffset++){
for(colOffset = -1; colOffset <=1; colOffset++){
x_dir = x_dir + input_image[i+rowOffset][j+colOffset]* Gx[1+rowOffset][1+colOffset];
y_dir = y_dir + input_image[i+rowOffset][j+colOffset]* Gy[1+rowOffset][1+colOffset];
}
}
edge_weight = ABS(x_dir) + ABS(y_dir);
output_image[i][j] = edge_weight;
}
先把下載的壓縮包在你的工作空間解壓
那麼接下來 開啟vivado HLS 注意不是 vivado
點擊 Open Project
開啟剛才解壓的工程 xapp890\sobel_rd_prj 點擊 ok
有如下介面
這是eclipse 改的
Source中是cpp檔案
Test Bench中是 測試檔案
可以看到 sobel_test.cpp 裡面有 main函數
點擊 產生RTL級演算法檔案
如果有FLEXnet Licensing error:-5,357
去申請一個30天試用license 教程 http://blog.sina.com.cn/s/blog_6759fd540101huec.html
可以看到 syn下面 有 Verilog 和 vhdl 檔案夾 這就是產生的演算法
然後點擊間HDL檔案打包 傳給EDK
好,後面我也不知道了。 不想學習,去玩耍了