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1. 類: 物件導向基礎傳統的物件導向編程與systemverilog類的特點，類的定義，成員與方法，建構函式，對象的複製和深/淺拷貝，父類/子類別關係，類的繼承，範圍的規則，對象的控制代碼以及賦值，方法的擴充和重寫，local/protected關鍵字，虛基類，虛方法，虛介面。

2. UVM基礎 ：UVM的發展曆史，可配置的測試組件，類庫結構，UVM核心基類的介紹，include/macro，UVM交易(data)，基本測試組件 (testbench components)，組件的phase結構，交易級建模，testcase，使用+uvm_testname 命令列運行測試，UVM測試平台的運行與終止，objection機制。

3. UVM的transaction類 transaction/components推薦定義的標準格式，uvm_sequence_item與uvm_transaction，field micros和field micro flag，transaction的(受限)隨機化，標準的transaction方法，方法的重寫。

4. UVM驅動類組件(uvm_driver,uvm_sequencer,uvm_agent,uvm_env) ,UVM組件的註冊方法，interface在串連DUT及各個組件中的應用，驅動類組件的結構和定義，建構函式，各組件的串連。

5. UVM monitor/checker： monitor/checker的結構及其在測試平台中的作用，scoreboard, functioanal coverage的應用。

6. UVM TLM(Transaction Level Modeling) TLM port/export, get/put/transport操作，analysis連接埠，`uvm_analysis_imp_decl宏的使用，uvm_tlm_fifo的實際應用。

7. UVM的config/factory/callback機制 config格式，set/get使用規則，原廠模式簡介，UVM原廠模式使用步驟，回調模式，callback在UVM中的應用 

8. sequence generation sequence標準形式，sequence與sequencer/driver串連，產生資料並發往DUT， 複雜sequence的級聯，virtual sequence/sequencer。

9. 寄存器的驗證寄存器驗證基本結構，寄存器模型結構，寄存器訪問方式(前門/後門)

 

參考文獻：

原文地址：http://www.asicdv.com/about.asp?typesA=3

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