[筆記].菜農M0助學板之GPIO按鍵之邊沿檢測小練(寄存器操作方式)

已發貼至:http://bbs.21ic.com/viewthread.php?tid=233787現象解釋:  KED1雙邊沿控制LED1:按下亮鬆開滅  KEY2下降沿控制LED2 第一次按下即亮,第二次按下滅  KEY2上升沿控制LED3:第一次鬆開即亮,第二次鬆開即滅這個比較簡單,直接貼出代碼,大家可以驗證一下。main.c#include "nuc1xx.h"#include "DrvSYS.h"/********************************************

[文檔].艾米電子 – 算術運算電路,Verilog

文章目錄 1 算術電路2 資料比較子 3 移位元運算 對讀者的假設已經掌握:可程式化邏輯基礎 Verilog HDL基礎 使用Verilog設計的Quartus II入門指南 使用Verilog設計的ModelSIm入門指南  內容1 算術電路Verilog HDL中,+、-、*、/、%都是可以綜合的,其消耗的資源視器件資源不同而不同。譬如:+、-都會被綜合成Adder,每一位大約消耗一個LE(Cyclone II);*則會被綜合成乘法器,

[筆記].Cyclone III編程與配置的幾個問題解答

Q1 Remote System Upgrade需要哪些器件支援?A1 僅需要:配置晶片:裝載配置鏡像使用者邏輯(或Nios II):從遠端下載新的資料或更新後的資料ALTREMOTE_UPDATA宏功能:採用新的資料或更新後的資料,並重新設定內建專用RSU電路 Q2 如何使用RSU燒寫鏡像A2

用UltraISO寫入ISO映像到隨身碟USB-HDD啟動詳解 img_usb鏡像製作

img_usb啟動iso_usb啟動 原文連結:http://jjweb.5d6d.net/thread-823-1-1.html 相信大家看到過一種較出名的WinPE工具“完美者優盤維護系統”吧,但是奇怪的是,下載下來後發現是ISO格式,大家都知道ISO可以直接燒錄成光碟片使用,但為什麼這個WinPE叫“完美者優盤維護系統”呢,和優盤有什麼關係?其實是因為這個WinPE支援量產到優盤中使用的,但是新的問題又來了,很多朋友不知道量產是什麼東東,怎麼弄。沒關係,今天給大家介紹個不用量產的方法實現優

[文檔].艾米電子 – 編碼器與解碼器,Verilog

文章目錄 1 編碼器  2 解碼器3 碼型轉換器4 小結 對讀者的假設已經掌握:可程式化邏輯基礎 Verilog HDL基礎 使用Verilog設計的Quartus II入門指南 使用Verilog設計的ModelSIm入門指南  內容1 編碼器1.1 二進位編碼器二進位編碼器,即把來自2^n條輸入線路的資訊,編碼轉換成二進位碼。其輸入為獨熱碼,輸出為二進位碼。此處以4~2編碼器為例。 表1 4~2編碼器的真值表  代碼1.1.1

[筆記].關於AS/AP的RSU(遠程系統升級)的設計方案

AN603 是AS模式下,Arria II/Stratix IV/Stratix III的remote system upgrade參考設計,AN512是Cyclone III AP模式下remote system

[文檔].艾米電子 – 多路選取器與多路分解器,Verilog

文章目錄 1 多路選取器Multiplexer1.2 帶優先順序的多路選取器輔助閱讀參考 對讀者的假設已經掌握:可程式化邏輯基礎 Verilog HDL基礎 使用Verilog設計的Quartus II入門指南 使用Verilog設計的ModelSIm入門指南  內容1 多路選取器Multiplexer此處所說的多路選取器,為組合邏輯電路中的多路多路選取器:多路輸入,一路輸出。 1.1 不帶優先順序的多路選取器1.1.1

[文檔].艾米電子 – 邏輯門電路,Verilog

文章目錄 對讀者的假設內容小結輔助閱讀參考 對讀者的假設已經掌握:可程式化邏輯基礎 Verilog HDL基礎 使用Verilog設計的Quartus II入門指南 使用Verilog設計的ModelSIm入門指南  內容1 基本門電路1.1 採用結構化描述方式1. 使用Quartus II建立工程logic_gates,頂層模組名為logic_gates,1.1所示。 圖1.1 建立工程logic_gates 2.

HTML5 WebSocket之HelloWorld

原文http://fallenlord.blogbus.com/logs/110768932.html方案要實現一個WebSocket有很多方案,用戶端方面可以用原生的WebSocket對象,也可以使用類似Socket.IO、jQuery Websocket

[問答].Nios II、MIPS、Microblaze、ARM這幾個嵌入FPGA中的硬核,哪個運用廣、前景好?

原帖發在阿莫論壇。http://www.ourdev.cn/bbs/bbs_content.jsp?bbs_sn=4819160【3樓】 yuphone .COM 缺氧 ----------------------------------------------------------------------- 當然是Nios II。【5樓】 necho ----------------------------------------------------------------

[文檔].艾米電子 – Quartus II 10.0 安裝指南

文章目錄 1. 安裝步驟  1. 安裝步驟1.1. 選擇解壓縮臨時路徑開啟X:\Altera Software 10.0 Part A\_1_10.0軟體\檔案夾(X代表所用DVD的盤符)。雙擊10.0_quartus_windows.exe檔案。選擇解壓縮臨時路徑,此處選為C:/TEMP,僅做示範。  單擊Install,稍等片刻;等待時間視機器配置而定。解壓完畢,會彈出安裝畫面。 1.2. 安裝  單擊Next。  選中

[文檔].艾米電子 – 使用Verilog設計的ModelSim入門指南

文章目錄 說明平台內容進階閱讀參考 說明本文的部分章節,來源於本人翻譯的Terasic DE2-115的英文入門文檔。 平台軟體:ModelSim-Altera 6.5e (Quartus II 10.0) Starter Edition 內容1 設計流程使用ModelSim模擬的基本流程為: 圖1.1 使用ModelSim模擬的基本流程 2 開始2.1 建立工程開啟ModelSim後,其畫面2.1所示。 圖2.1 ModelSim畫面 1

[轉載].sscanf的用法

原作者不詳。名稱: sscanf() - 從一個字串中讀進與指定格式相符的資料.函數原型: Int sscanf( string str, string fmt, mixed var1, mixed var2 ... ); int scanf( const char *format [,argument]... );說明: sscanf與scanf類似,都是用於輸入的,只是後者以螢幕(stdin)為輸入源,前者以固定字串為輸入源。

[翻譯].計算FIFO的深度

文章目錄 介紹例子:FIFO深度計算

glade 與 gtk

 glade2 與 glade 3LibgladeGTK+ and Glade3 GUI Programming Tutorial GTK介面開發工具 GtkBuilderGlade 3與GTK+-2入門 知識點        glade3與glade2差別glade2產生代碼,而glade3隻產生xml檔案(實現了與代碼分離,支援其他語言調用,如python)     

z-index html

z-index html:<!DOCTYPE html PUBLIC "-//W3C//DTD XHTML 1.0 Transitional//EN" "http://www.w3.org/TR/xhtml1/DTD/xhtml1-transitional.dtd"><html xmlns="http://www.w3.org/1999/xhtml"><head><meta http-equiv="Content-Type" content="text/

HTML5本機存放區初探

原文地址:http://www.qianduan.net/local-storage-of-html5.htmlRobin 發表於 05. Jan, 2011, 分類: ShowCase , 18 條評論 »標籤:HTML5html5帶給我們的不僅僅是更多語義豐富的標籤,還有更多更牛逼的特性,比如“離線儲存”。 對於台式電腦來說,或者它並沒有帶來什麼驚喜,但是對於行動裝置來說離線儲存簡直就是一個神跡。對於任何擁有支援離線儲存瀏覽器的行動裝置,比如iphone,ipod

[文檔].艾米電子 – 使用Verilog設計的Quartus II入門指南

文章目錄 典型的CAD流程1. 開始2 建立工程3 使用Verilog代碼設計輸入4 編譯設計電路5 引腳分配6 模擬所設計的電路7 編程及配置FPGA器件 8 測試設計電路 說明本文的部分章節,來源於本人翻譯的Terasic DE2-115的英文入門文檔。 平台硬體:艾米電子EP2C8-2010增強版套件軟體:Quartus II 10.0 + ModelSim-Altera 6.5e (Quartus II 10.0) Starter

[筆記].關於Stratix III使用非易失加密後,無法正常配置啟動的問題探討

Stratix III內建256 AES加密,分為易失加密和非易失加密兩種,具體請參見應用筆記AN512和AN552。近期有客戶回函,Stratix III使用非易失加密後,無法boot。經過一個多禮拜的排解。現在確認,使用91sp2根據密鑰產生jic,下載後,是無法正常配置啟動的。換用11.0根據密鑰產生jic,下載後,可以正常配置啟動。不過,無論91sp2還是11.0都是可以燒入密鑰的。

(筆記) 如何設定Debussy / Verdi的input / output port顏色? (SOC) (Debussy) (Verdi)

Abstract在trace code時,我們通常會將input port與output port拉出來waveform觀察,瞭解該module的in out關係,若有必要再深入到內部的register, wire與state,所以若能將input / output port用不同的顏色顯示,有別於register, wire與state,將有助於trace code的進行。Introduction使用環境:Debussy 5.4v9 (Windows版), Verdi 2010.10

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